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RISC-V峰会:半导体器件尺寸缩减模式的终结

发布于:2024-06-06 编辑:匿名 来源:网络

Codasip微信公众号,eeNews Europe,2020年12月,定制RISC-V处理器半导体知识产权(IP)核的领先供应商Codasip最近宣布该公司已任命 Ron Black 博士为首席执行官。

Codasip 在打造全球团队方面取得了实质性进展,任命 Brett Cline 为首席营收官,Rupert Baines 为首席营销官,Simon Bewick 为英国研发副总裁。

”Codasip 创始人 Karel Masa?ík 博士现已晋升为公司总裁,负责 RISC-V 先进产品和技术的研究。

Masa?ík 博士评价道:“我与 Ron 认识并合作了近十年,他帮助转型并帮助公司。

他拥有丰富的扭亏为盈的经验,这对Codasip的业务增长和发展演变具有重要意义。

” Codasip首席执行官Ron Black近日接受了eeNews Europe的采访,阐述了他对公司未来发展以及行业关注热点话题的看法。

对于行业未来的竞争,Black表示,“这是一场已经达到了一个新高度的竞争。

”临界值。

这不仅仅是 RISC-V 作为替代方案。

” Black 表示,Codasip 的强大之处在于其高效的软硬件协同设计技术;Codasip 感兴趣的是设计工具‘Studio’和处理器描述语言 CodAL。

这提供了基于Black 博士将于 12 月 8 日下午 2:10 在 RISC-V 峰会上发表题为“半导体器件尺寸缩减模型的终结”的主题演讲,然后描述摩尔定律终结带来的机遇。

MOSFET 缩放。

由于晶体管功耗与电容、频率和电压的平方成正比,罗伯特·登纳德 (Robert Dennard) 在本文中提出,应通过在降低的电压、较小的电容和较高的频率下运行来提高性能。

漏电流和阈值电压开始成为重要的障碍,并为每个晶体管建立了功率基线,这形成了功率墙,在十多年来将处理器时钟频率限制在最高约 5GHz。

“与映射的传统通用处理器相比,性能没有任何改进,而 5 纳米处理器是一个价值 5 亿美元的芯片,”Black 在谈到前沿处理器的潜在开发成本时说道。

“因此,趋势是异构设计和特定领域设计,但仍然存在扩展问题。

基本上有三种方法可以解决这个问题。

布莱克说,第一种方法是将处理器从电子转移到光子。

“有一些有趣的初创公司正在这样做,但这可能需要十多年的时间。

” “第二种方法是改变材料。

”其中一些已经在进行中。

碳纳米管可能就是这种情况,台积电可能会将其中一些碳纳米管纳入其 2nm 工艺中。

RISC-V峰会:半导体器件尺寸缩减模式的终结

”Black说道。

Black总结道,第三种方法是软件和硬件共同开发,即能够分析ISA和处理器微架构并对其进行调整。

因此,对于Codasip来说,一切看起来都很公平,但是这家初创公司需要资金。

根据现有报道,Codasip 总共仅筹集了约 10,000 美元,其中包括 12 月份的 10,000 美元 A 轮融资,尽管 Codasip 是一家“软”公司:其“现金消耗率”为 10,000 美元,几名员工认为 10,000 美元不足以维持其发展对此,布莱克表示,“公司还有一些投资尚未公布。

”布莱克还表示,“我们已经获得了可观的收入。

” :我们谈论的是IP产品收入,而不是设计服务收入。

已经有 20 亿颗芯片配备了 Codasip RISC-V IP。

“假设每个芯片的特许权使用费仅为 1 美分,这意味着潜在的收入为 10,000 美元。

如果特许权使用费更高,收入数字看起来会更好。

” CHIPLET Question Black 还回答了有关多芯片组件的 Chiplet 的问题。

组装观念将如何影响IP核市场的问题是,从某种意义上说,Chiplet可以被视为IP核的替代品,但IP供应商必须承担硅生产的前期成本。

“这是知识产权交付方法的自然组成部分。

延长。

Black表示,“一些客户已经要求我们这样做。

”如果真是这样,IP公司未来可能会变得不那么“软”,需要更多的资源来支付chiplet制造和裸芯片以推进封装站的衰落。

但这将反映在定价中,并允许小型芯片供应商保留更多他们创造的价值:“从战略上讲,Codasip 处于有利地位 - 拥有出色的技术和合适的市场。

世界一流的工程团队,但这只是一个秘密。

RISC-V 为使用 Codasip Studio EDA 工具和 CodAL 处理器描述语言的定制处理器和 IP 提供了大量机会,并且可以说是开发此类高质量、差异化产品的最简单方法。

RISC-V峰会:半导体器件尺寸缩减模式的终结

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